PCB 设计注意事项系列 5：时钟和网口 -

标题: PCB 设计注意事项系列 5：时钟和网口 [打印本页]

作者: Gropher 时间: 2017-5-3 17:49
标题: PCB 设计注意事项系列 5：时钟和网口

CLK 分类：

1） HostClock：MCH_BCLK（差分信号）和 CPU_BCLK（差分信号），166/200MHZ

2） PCI_CLK：PCI_CLK【5:0】，33MHZ

3） REFCLK：14MHZ

4） USBCLK：48MHZ

5） DOTCLK：96MHZ

6） SRCCLK：（serial referenceclock）100MHZ

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