PCB设计中高速信号关键信号的布线要求

ID:156167 · 发表于 2017-10-19 16:02

本期讲解PCB设计中高速信号关键信号的布线要求。

一、时钟信号布线要求

在数字电路设计中，时钟信号是一种在高态与低态之间振荡的信号，决定着电路的性能。时钟电路在数字电路中点有重要地位，同时又是产生电磁辐射的主要来源。时钟的处理方法也是在PCB布线时需要特别重视的。在一开始就理清时钟树，明确各种时钟之间的关系，布线的时候就能处理得更好。并且时钟信号也经常是EMC设计的难点，需要过EMC测试指标的项目尤其要注意。

时钟线除了常规的阻抗控制和等长要求外，还需要注意以下问题。

1. 时钟信号尽量选择优选布线层。

2. 时钟信号尽量不跨分割，更不要沿着分割区布线。

3. 注意时钟信号与其他信号的间距，至少满足3W。

4. 有EMC要求的设计，较长的时候线尽量选择内层布线。

5. 注意时钟信号的端接匹配。

6. 不要采用菊花链结构传送时钟信号，而应采用星型结构，即所有的时钟负载直接与时钟功率驱动器相互连接。

7. 所有连接晶振输入/输出端的导线尽量短，以减少噪声干扰及分布电容对晶振的影响。

8. 晶振电容地线应使用尽量宽而短的导线连接至器件上；离晶振最近的数字地引脚，应尽量减少过孔。

9. 在数字电路中，通常的时钟信号都是边沿变化快的信号，对外串扰大。所以在设计中，时钟线宜用地线包围起来并多打地线也来减少分布电容，从而减少串扰；对高频信号时钟尽量使用低电压关分时钟信号并包地方式，需要注意包地打孔的完整性。

二、模拟信号布线要求

模拟信号的主要特点是抗干扰性差，布线时主要考虑对模拟信号的保护。