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verilog模块封装关于多位二进制变量的输出连接问题

ID:361065 发表于 2020-4-24 18:03 | 显示全部楼层 |阅读模式

verilog语言编写的程序封装成模块，8位二进制变量输出不能直接连接output，该怎样连接输出呢？图片中的qs，qm，qh都是8位二进制，在仿真时采用2位十六进制输出波形，这三个的output如何连接？

51hei截图20200424180106.png

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