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如何用verilog编写触发器呢 求帮助

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楼主
ID:731309 发表于 2020-4-17 19:40 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
1．使用Quartus Prime软件设计异步复位的RS触发器；
2．使用Quartus Prime软件设计异步复位、同步置位的D触发器；
3．使用Quartus Prime软件设计异步复位、通步置位、同步使能的JK触发器；
4．使用Quartus Prime软件设计异步复位、异步置位、同步使能的T触发器。

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