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数电实验 设计2位58进制计数器的电路图

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ID:664932 发表于 2019-12-16 10:56 | 显示全部楼层 |阅读模式
1.画出实验电路

51hei.png
设计的电路图如下:
WX20191216-105441@2x.png

按照图 1 所示,在仿真软件 Multisim 中完成原理图绘制,观察显示结果,再将时钟信号源频率设置为 10Hz,观察显示结果,并对前后两种显示结果进行简单地比较与分析。 图一在上面,在改变了频率了之后,发现了如果频率越大,那么上面的显示器改变的越快,原本 100 赫兹改为了 10 赫兹了以后,发现变慢了一倍。

2.观察仿真结果
可以看出,上面的时钟可以从 0-57,符合 2 位 58 进制计数器的电路,仿真结果是正确的。

3.验证RCO输出端与计数值QD-QA的逻辑关系
第一个芯片RCO连接第二个的 CLK,当第一个芯片的QD-QA显示为 1111 时,此时的第一个芯片的 RCO 变成了 1,那么此时第二个的 CLK 就变成 1,于是第二个芯片开始工作,此时第二个芯片的 QD-QA 为 0001,第一个芯片则变成 0000。以此循环,每当第一个芯片的 QD-QA 显示为 1111 时,第二个芯片都会+1,直到 QD-QA 变成0011 为止。此时当第一个 QD-QA 显示 1011。结束,从新开始,这就是一个轮回。

4.ENP和ENT的作用
ENP 和 ENT 两个的作用是当计数到 57 的时候,可以做到清零变成 00000000 最初始的位置。  

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