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Verilog 变量

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楼主
ID:579775 发表于 2020-12-8 17:04 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
变量即在程序运行过程中其值可以改变的量,在Verilog HDL中变量的数据类型有很多种,这里只对常
用的几种进行介绍。
网络数据类型表示结构实体(例如门)之间的物理连接。网络类型的变量不能储存值,而且它必需受到
驱动器(例如门或连续赋值语句,assign)的驱动。如果没有驱动器连接到网络类型的变量上,则该变
量就是高阻的,即其值为z。常用的网络数据类型包括wire型和tri型。这两种变量都是用于连接器件
单元,它们具有相同的语法格式和功能。之所以提供这两种名字来表达相同的概念是为了与模型中所
使用的变量的实际情况相一致。wire型变量通常是用来表示单个门驱动或连续赋值语句驱动的网络型
数据,tri型变量则用来表示多驱动器驱动的网络型数据。如果wire型或tri型变量没有定义逻辑强度
(logic strength),在多驱动源的情况下,逻辑值会发生冲突从而产生不确定值。下表为wire型和
tri型变量的真值表(注意:这里假设两个驱动源的强度是一致的,关于逻辑强度建模请参阅附录:
Verilog语言参考书)。
wire/tri 0 1 x z
0 0 x x 0
1 x 1 x 1
x x x x x
z 0 1 x z
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