基于FPGA的DDS频率合成器设计视频教程与源码下载

FPGA dds的全套设计资料分享给51hei的朋友们，有需要可以下载学习。

下面是DDS频率合成器视频教程内容截图（代码讲解）：


部分源程序如下:

1. `timescale 1ns / 1ps
   
2. /*==============================================================================
   
3. Engineer            : Xjtao
   
4. Module Hierarchy    : top function module
   
5. Design Name         : dds_module.v
   
6. Module Name         : dds_module
   
7. Project Name        : test_project_top.qsf
   
8. Target Devices      : Altera
   
9. Tool versions       : QUARTUSII11.0/Windows XP
   
10. Description         : DDS模块实现将cos及sin数据产生，输出频率：(Fs*i_nco/500)MHz
    
11. Dependencies        :                       
    
12. Revision            : 0.01 - File Created
    
13. Additional Comments : ROM存储数据的个数，fs/fmin=25/0.05=500
    
14. ==============================================================================*/
    
15. module dds_module(
    
16.   input          i_fpga_clk          ,//25MHz
    
17.   input          i_rst_n                  ,
    
18.   input   [8:0]  i_nco                    ,//频率控制字
    
19. 
    
20.   output  [7:0]  o_cos                    ,//余弦波
    
21.   output  [7:0]  o_sin                     //正弦波
    
22. );
    
23. //================================================================================
    
24. // 0、        频率控制字累加,相位累加
    
25. //================================================================================
    
26.     wire [8:0]  w_rom_addr  ;
    
27. dds_phase_acc #(
    
28.         .NCO_WIDTH         (9           ),  //nco配置位宽                     
    
29.         .ADDR_WIDTH (9           )  //输出地址位宽
    
30. )u0_dds_phase_acc (
    
31.     .i_fpga_clk (i_fpga_clk ) ,
    
32.     .i_rst_n    (i_rst_n    ) ,
    
33.     .i_frq_nco  (i_nco      ) ,
    
34. 
    
35.     .o_rom_addr (w_rom_addr )
    
36.    );
    
37.    
    
38. //================================================================================
    
39. // 1、        根据累加相位查找cos及sin的ROM,产生正余弦信号
    
40. //================================================================================
    
41.         wire [7:0] w_cos ;
    
42.         wire [7:0] w_sin ;
    
43. dds_cos_rom u1_dds_cos_rom(
    
44.   .i_fpga_clk        (i_fpga_clk) ,
    
45.   .i_rst_n    (i_rst_n   ) ,
    
46.   .i_rd_addr  (w_rom_addr) ,
    
47.   .o_cos      (w_cos     )
    
48.   );
    
49. 
    
50. dds_sin_rom u2_dds_sin_rom(
    
51.   .i_fpga_clk        (i_fpga_clk) ,
    
52.   .i_rst_n           (i_rst_n   ) ,
    
53.   .i_rd_addr         (w_rom_addr) ,
    
54.   .o_sin             (w_sin     )
    
55.   );
    
56.         
    
57. //================================================================================
    
58. // 2、        output                                                                  
    
59. //================================================================================
    
60.         assign o_cos = w_cos        ;
    
61.         assign o_sin = w_sin        ;
    
62.         
    
63. //================================================================================
    
64. endmodule
    

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Advanced_Lab01_DDS design.rar (13.78 MB, 下载次数: 70)

2018-5-14 22:42 上传

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资料还不错哟